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io
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n
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S
M
t
0
0 - 22
HMC700LP4 / 700LP4E
v11.0411
8 GHz 16-Bit Fractional-N PLL
Table 16. Reg 09h CP Register
Bit
name
Width
Default
Description
[1:0]
reserved set them to 0
2
0
[4:2]
cp_UPoffset_sel
3
0
charge Pump UP offset control 55ua/step
000 = 0ua
001 = 55ua
010 = 110ua
...
111 = 385ua
[6:5]
reserved Set them to 0
2
0
[9:7]
cp_Dnoffset_sel
3
0
charge Pump Dn offset control 55ua/step
000 = 0ua
001 = 55ua
010 = 110ua
...
111 = 385ua
[13:10]
cfg cp_UPtrim_sel
4
0
charge Pump UP current trim 7ua/step
0000 = 0ua
0001 = 7ua
0010 = 14ua
0100 = 28ua
1000 = 56ua
1111 = 105ua
[17:14]
cp_Dntrim_sel
4
0
charge Pump Dn current trim 7ua/step
0000 = 0ua
0001 = 7ua
0010 = 14ua
0100 = 28ua
1000 = 56ua
1111 = 105ua
[20:18]
cp_UPcurrent_sel
3
0
charge Pump UP Main current control 500ua step
000 tristate if PFD also disabled
001 500ua
010 1000ua
011 1500ua
100 2000ua
101 2000ua
110 2000ua
111 2000ua
[23:21]
cp_Dncurrent_sel
3
0
charge Pump UP Main current control 500ua step
000 tristate if PFD also disabled
001 500ua
010 1000ua
011 1500ua
100 2000ua
101 2000ua
110 2000ua
111 2000ua
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